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题名/责任者:

Verilog HDL数字系统设计及仿真/于斌编著

出版发行项:

北京:电子工业出版社,2014.03

ISBN及定价:

978-7-121-22284-9/CNY65.00 (含光盘)

ISBN及定价:

978-7-89432-814-4 光盘

载体形态项:

448页:图;26cm+光盘1片

丛编项:

工程设计与分析系列

个人责任者:

于斌 编著

学科主题:

硬件描述语言-程序设计

非控制主题词:

VHDL语言

中图法分类号:

TP312VH

提要文摘附注:

Verilog HDL是一门使用广泛的硬件描述语言, 目前在国内无论是集成电路还是嵌入式设计的相关专业都会使用到这种硬件描述语言。本书着重从设计角度入手, 每章都力求让读者掌握一种设计方法, 能够利用本章知识进行完整的设计, 从模块的角度逐步完成对Verilog HDL语法的学习, 从而整体掌握Verilog HDL愈发。

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