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题名/责任者:

Verilog HDL数字系统设计/王建民, 田晓华, 江晓林编著

出版发行项:

哈尔滨:哈尔滨工业大学出版社,2017

ISBN及定价:

978-7-5603-6721-7/CNY68.00

载体形态项:

380页;26cm

并列正题名:

Digital design using Verilog HDL

丛编项:

电子与信息工程系列

个人责任者:

王建民 编著

个人责任者:

田晓华 编著

个人责任者:

江晓林 编著

学科主题:

硬件描述语言-程序设计-高等学校-教材

中图法分类号:

TP312VH

一般附注:

“十二五”国家重点图书出版规划项目

书目附注:

有书目 (第380页)

提要文摘附注:

本书通过大量完整的实例介绍了基于Verilog HDL进行数字系统设计的基本原理、概念和方法。全书重点关注基于HDL的寄存器传输级(Register Transfer Level，RTL)的数字系统设计，主要内容包括数字电路基础回顾、组合逻辑设计、规则时序逻辑、有限状态机等。

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